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ZYNQ7035_AD9361_PL_V1.2.rar

rerainings  上传  121.97 MB   文件格式  RAR AD PL

// Profile: LTE 20 MHz
// REFCLK_IN: 40.000 MHz

RESET_FPGA
RESET_DUT

BlockWrite 2,6 // Set ADI FPGA SPI to 20Mhz
SPIWrite 3DF,01 // Required for proper operation
ReadPartNumber
SPIWrite 2A6,0E // Enable Master Bias
SPIWrite 2A8,0E // Set Bandgap Trim
REFCLK_Scale 40.000000,1,2 // Sets local vari

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